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FPGA培訓(xùn)

FPGA研究

FPGA培訓(xùn)-知識(shí)提綱（1）

FPGA培訓(xùn)-知識(shí)提綱（2）

FPGA培訓(xùn)-知識(shí)提綱（3）

FPGA培訓(xùn)-知識(shí)提綱（4）

FPGA培訓(xùn)-知識(shí)提綱（5）

FPGA培訓(xùn)-知識(shí)提綱（2）-2010年01月21日

FPGA培訓(xùn)實(shí)驗(yàn)要點(diǎn)--FPGA語(yǔ)法知識(shí)

3.5 Verilog HDL的條件語(yǔ)句

3.5.1 if 語(yǔ)句

（1）無(wú)分支
if (表達(dá)式)
語(yǔ)句；
（2）單級(jí)分支
if(表達(dá)式）
語(yǔ)句1；
else
語(yǔ)句2；

(3)多級(jí)分支
if (表達(dá)式1) 語(yǔ)句1；
else if (表達(dá)式2) 語(yǔ)句2；
else if(表達(dá)式3） 語(yǔ)句3；
。。。。

else 語(yǔ)句n;
注意：
a.0\x\z,按假處理
b.值為1按真 處理
c.else前要有分號(hào)
d.if(expression)----if (expression==1)
if(!expression)---if(expression!==1)
e.if ()
begin
if() 語(yǔ)句1 （內(nèi)嵌if）
end
else 語(yǔ)句2

3.5.2 case語(yǔ)句
（1）case (表達(dá)式） <case 分支項(xiàng)> endcase
(2)casez(表達(dá)式） endcase;---用來(lái)處理不考慮高阻值Z
(3）casex(表達(dá)式) endcase;--將高阻值和不定值都不處理

注意：
a.default項(xiàng)可有可無(wú)，而且一個(gè)case語(yǔ)句中只能有一個(gè)
default項(xiàng)
b.所有表達(dá)式的值位寬相等
c.if 和case語(yǔ)句只能用于always內(nèi)部
如果在always塊外部使用，三目運(yùn)算

3.6 其他常用語(yǔ)句
主要有4種：
（1）forever
(2)repeat：可以以指定一條語(yǔ)句要執(zhí)行多少次
（3）while
（4）for
1.forever語(yǔ)句
格式：
forever 語(yǔ)句；

多條語(yǔ)句：
forever begin
多條語(yǔ)句；
end
2.repeat語(yǔ)句：
語(yǔ)句格式：
repeat (表達(dá)式) 語(yǔ)句；

多條語(yǔ)句：
repeat (表達(dá)式) begin

多條語(yǔ)句；

end

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